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基于VHDL状态机的智力抢答器的设计与实现

Design and Implementation of Intelligence Responder Based on VHDL State Machine
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摘要 根据智力抢答器设计的要求,此系统所要求的功能有抢答鉴别、抢答计时、各组得分累加和动态显示功能等。采用VHDL状态机对其设计,设计思路清晰,编程易懂易读,简单明了,从而提高设计的灵活性和可靠性,降低电路的设计成本,缩短设计周期。 According to the requirements of intelligence responder design,this system must include some functions as follows: responder identification,answer in time,cumulative scores of each group and dynamic display function.Uses VHDL state machine,design ideas clear,readable programming and easy to understand,simple to understand.Thus enhances the flexibility and reliability of design,reduces the circuit design cost and shortens the design cycle.
出处 《现代计算机》 2010年第6X期69-71,共3页 Modern Computer
关键词 有限状态机(FSM) VHDL 智力抢答器 Finite State Machine VHDL Intelligence Responder
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