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一种新型多DSP并行计算结构及其应用 被引量:14
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作者 王祖斌 彭应宁 +2 位作者 王秀坛 汤俊 王希勤 《系统工程与电子技术》 EI CSCD 北大核心 2001年第3期19-22,共4页
传统的雷达信号处理系统的设计方法是针对特定应用的 ,因此系统的通用性差 ,而具有超级计算机体系结构的通用高速实时雷达信号处理系统有望解决这一问题。该系统的关键部件为担负具体计算任务的处理结点。首先提出了一种新型的、由 5片A... 传统的雷达信号处理系统的设计方法是针对特定应用的 ,因此系统的通用性差 ,而具有超级计算机体系结构的通用高速实时雷达信号处理系统有望解决这一问题。该系统的关键部件为担负具体计算任务的处理结点。首先提出了一种新型的、由 5片ADSP - 2 10 6x构成的多DSP并行计算结构。它具有运算能力强、I/O带宽大、通信手段多样、能灵活地改变拓扑结构、可扩展、通用性强等特点。并且以此并行计算结构为核心设计实现了通用高速实时雷达信号处理系统的处理结点。 展开更多
关键词 雷达 数字信号处理 计算机体系结构 并行计算结构
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图像小面模型拟合的快速并行计算结构
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作者 颜露新 张天序 +1 位作者 张贵清 郭畅 《数据采集与处理》 CSCD 北大核心 2006年第B12期59-62,共4页
提出了一种图像小面模型拟舍的快速并行计算结构。推导了以离散切比雪夫正交多项式为基底的图像小面模型拟合过程,分析了其计算结构和内在的并行性。计算结构包括滑动窗产生单元、多路卷积单元和拟合单元,整体为流水线结构,而后两者均... 提出了一种图像小面模型拟舍的快速并行计算结构。推导了以离散切比雪夫正交多项式为基底的图像小面模型拟合过程,分析了其计算结构和内在的并行性。计算结构包括滑动窗产生单元、多路卷积单元和拟合单元,整体为流水线结构,而后两者均采用空间并行结构。基于小面模型的序列图像插值实验结果表明,该计算结构占用存储空间少、数据延迟小、实时性强,提高了小面模型拟合的实用性。 展开更多
关键词 小面模型 图像拟合 插值 边缘检测 并行计算结构FPGA
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SVM的并行计算结构研究及FPGA实现 被引量:5
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作者 胡福平 徐美华 沈华明 《微电子学与计算机》 CSCD 北大核心 2018年第6期79-83,共5页
本文基于FPGA平台提出了一种用于SVM硬件实现的并行计算结构,利用Verilog HDL语言完成了各模块的结构设计,并进行了仿真和实验验证.仿真结果表明对比Libsvm的训练时间,该并行结构实现了3.5倍的加速比.实验结果表明在相同的参数条件下,... 本文基于FPGA平台提出了一种用于SVM硬件实现的并行计算结构,利用Verilog HDL语言完成了各模块的结构设计,并进行了仿真和实验验证.仿真结果表明对比Libsvm的训练时间,该并行结构实现了3.5倍的加速比.实验结果表明在相同的参数条件下,该结构实现的SVM的分类性能要略优于Libsvm,分类效果得到了保证,并且最大时钟频率能达到190.331 MHz,具有较高的计算效率. 展开更多
关键词 支持向量机 FPGA 模式分类 并行计算结构
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二维正交子波变换的VLSI并行计算 被引量:3
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作者 陈崚 《电子学报》 EI CAS CSCD 北大核心 1995年第2期95-97,共3页
本文提出一个二维离散正交子波变换的VLSI并行结构,该结构将二维输入信号分解成不重叠的若干行组,从而使每组中的所有行被并行处理,而不同组的行的处理、不同级上的计算,以至不同信号的计算可以在此结构上流水线地进行。
关键词 子波变换 VLSI并行计算结构
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《并行计算系统》课程的引导性教学与实践 被引量:1
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作者 刘敏 张素莉 《现代计算机》 2016年第24期36-38,共3页
对于《并行计算系统》课程的初学者来说,由于其概念、算法、理论有别于传统的单机知识体系,因而往往会产生高深和新难的预感。为使学生平缓顺利地进入该课程学习,在课程之初增设引导性讲座是一种可行的尝试性教学实践,取得较好的教学效果。
关键词 单机体系结构:并行计算体系结构 引导性教学
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集群先进计算机的结构分析平台 被引量:2
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作者 袁勇 曹骥 《结构工程师》 2003年第z1期323-328,共6页
本文讨论了在集群计算机环境下实现并行结构分析平台的可行性和具体实现过程.首先探讨了并行计算环境的软硬件实现条件.其次关注并行结构分析平台的并行策略、整体刚度矩阵的并行组集和结构平衡方程组的并行求解等.文末给出了具体的计... 本文讨论了在集群计算机环境下实现并行结构分析平台的可行性和具体实现过程.首先探讨了并行计算环境的软硬件实现条件.其次关注并行结构分析平台的并行策略、整体刚度矩阵的并行组集和结构平衡方程组的并行求解等.文末给出了具体的计算实例并做了讨论. 展开更多
关键词 计算 集群 并行计算 结构分析 有限元
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基于FPGA的自定义CPU架构设计 被引量:3
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作者 李俊 任连新 廖振雄 《电子技术应用》 2020年第5期40-43,49,共5页
为满足当前工业应用下越来越多的分布式计算的需求,提出了一种在FPGA芯片中构建自定义指令集的CPU的方式,以此来使FPGA具有类似于单片机的处理指令的能力。并且,这种能力的前提是复用计算单元,因此资源消耗有限,不会随着计算量的增加而... 为满足当前工业应用下越来越多的分布式计算的需求,提出了一种在FPGA芯片中构建自定义指令集的CPU的方式,以此来使FPGA具有类似于单片机的处理指令的能力。并且,这种能力的前提是复用计算单元,因此资源消耗有限,不会随着计算量的增加而增大。在自定义指令集CPU的改进型架构中,使用了并行计算的结构,使得运算速度大幅提升。最后,结合实际应用案例,移植电流环计算中的FOC算法到自定义CPU中运算。并用ModelSim软件进行仿真,测试其计算时间仅需7.48μs。 展开更多
关键词 自定义指令集 CPU架构 FPGA 并行计算结构 FOC
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Parallel Computing of the Underwater Explosion Cavitation Effects on Full-scale Ship Structures 被引量:7
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作者 Zhi Zong Yanjie Zhao +2 位作者 Fan Ye Haitao Li Gang Chen 《Journal of Marine Science and Application》 2012年第4期469-477,共9页
As well as shock wave and bubble pulse loading, cavitation also has very significant influences on the dynamic response of surface ships and other near-surface marine structures to underwater explosive loadings. In th... As well as shock wave and bubble pulse loading, cavitation also has very significant influences on the dynamic response of surface ships and other near-surface marine structures to underwater explosive loadings. In this paper, the acoustic-structure coupling method embedded in ABAQUS is adopted to do numerical analysis of underwater explosion considering cavitation. Both the shape of bulk cavitation region and local cavitation region are obtained, and they are in good agreement with analytical results. The duration of reloading is several times longer than that of a shock wave. In the end, both the single computation and parallel computation of the cavitation effect on the dynamic responses of a full-scale ship are presented, which proved that reloading caused by cavitation is non-ignorable. All these results are helpful in understanding underwater explosion cavitation effects. 展开更多
关键词 underwater explosion CAVITATION parallel computation full-scale ship
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An new representation for interconnection network structures 被引量:1
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作者 刘丽华 陈建二 +1 位作者 陈松乔 贾维嘉 《Journal of Central South University of Technology》 2002年第1期47-53,共7页
An important theoretic interest is to study the relations between different interconnection networks, and to compare the capability and performance of the network structures. The most popular way to do the investigati... An important theoretic interest is to study the relations between different interconnection networks, and to compare the capability and performance of the network structures. The most popular way to do the investigation is network emulation. Based on the classical voltage graph theory, the authors develop a new representation scheme for interconnection network structures. The new approach is a combination of algebraic methods and combinatorial methods. The results demonstrate that the voltage graph theory is a powerful tool for representing well known interconnection networks and in implementing optimal network emulation algorithms, and in particular, show that all popular interconnection networks have very simple and intuitive representations under the new scheme. The new representation scheme also offers powerful tools for the study of network routings and emulations. For example, we present very simple constructions for optimal network emulations from the cube connected cycles networks to the butterfly networks, and from the butterfly networks to the hypercube networks. Compared with the most popular way of network emulation, this new scheme is intuitive and easy to realize, and easy to apply to other network structures. 展开更多
关键词 interconnection network network emulation parallel computation
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Hardware Architecture for RSA Cryptography Based on Residue Number System
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作者 郭炜 刘亚灵 +2 位作者 白松辉 魏继增 孙达志 《Transactions of Tianjin University》 EI CAS 2012年第4期237-242,共6页
A parallel architecture for efficient hardware implementation of Rivest Shamir Adleman(RSA) cryptography is proposed.Residue number system(RNS) is introduced to realize high parallelism,thus all the elements under the... A parallel architecture for efficient hardware implementation of Rivest Shamir Adleman(RSA) cryptography is proposed.Residue number system(RNS) is introduced to realize high parallelism,thus all the elements under the same base are independent of each other and can be computed in parallel.Moreover,a simple and fast base transformation is used to achieve RNS Montgomery modular multiplication algorithm,which facilitates hardware implementation.Based on transport triggered architecture(TTA),the proposed architecture is designed to evaluate the performance and feasibility of the algorithm.With these optimizations,a decryption rate of 106 kbps can be achieved for 1 024-b RSA at the frequency of 100 MHz. 展开更多
关键词 residue number system RSA cryptography Montgomery algorithm computer architecture parallelalgorithm
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The Methodology of Application Development for Hybrid Architectures
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作者 Vladimir Orekhov Alexander Bogdanov Vladimir Gaiduchok 《Computer Technology and Application》 2013年第10期543-547,共5页
This paper provides an overview of the main recommendations and approaches of the methodology on parallel computation application development for hybrid structures. This methodology was developed within the master's ... This paper provides an overview of the main recommendations and approaches of the methodology on parallel computation application development for hybrid structures. This methodology was developed within the master's thesis project "Optimization of complex tasks' computation on hybrid distributed computational structures" accomplished by Orekhov during which the main research objective was the determination of" patterns of the behavior of scaling efficiency and other parameters which define performance of different algorithms' implementations executed on hybrid distributed computational structures. Major outcomes and dependencies obtained within the master's thesis project were formed into a methodology which covers the problems of applications based on parallel computations and describes the process of its development in details, offering easy ways of avoiding potentially crucial problems. The paper is backed by the real-life examples such as clustering algorithms instead of artificial benchmarks. 展开更多
关键词 Hybrid architectures parallel computing simulation modeling.
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