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数字信号处理器中高性能可重构加法器设计 被引量：1
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作者 马鸿 李振伟 彭思龙 《计算机工程》 CAS CSCD 北大核心 2009年第12期1-4,共4页
设计一款适用于高性能数字信号处理器的16位加法器。该加法器结合条件进位选择和条件"和"选择加法器的特点,支持可重构,可以进行2个16位数据或者4个8位数据的加法运算,同时对其进位链进行优化。相对于传统的条件进位选择加法... 设计一款适用于高性能数字信号处理器的16位加法器。该加法器结合条件进位选择和条件"和"选择加法器的特点,支持可重构,可以进行2个16位数据或者4个8位数据的加法运算,同时对其进位链进行优化。相对于传统的条件进位选择加法器,在典型工作条件下,采用0.18μm工艺库标准单元,其延时降低46%,功耗降低5%。 展开更多
关键词 条件进位选择加法器 条件“和”选择加法器 可重构加法器
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