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直接访问系统配置存储器的方法与实例
1
作者 邓波 李劲松 蒲昌平 《微型机与应用》 1994年第12期33-36,共4页
讨论直接操作CMOS数据的方法及有关程序,并解释了系统配置存储器中各字节所代表的意义,以便于用户在没有设置软件或因系统故障不能进入系统CMOS设置程序时,用手工方式进行CMOS参数的设置,并给出了一个改变CMOS软驱动器设置的操作实例.
关键词 存储器 配置 直接访问系统 CMOS
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高性能DSP软核中DMA控制器的设计与验证 被引量：2
2
作者 郑挺 李勇 《计算机工程与设计》 CSCD 北大核心 2014年第1期112-118,共7页
为解决数字信号处理器(digital signal processor,DSP)的数据供给问题,设计了一个可高效搬运数据的部件———直接存储器访问控制器(direct memory access controller,DMAC)。采用了模拟验证方法和基于断言的验证方法对设计进行了功能... 为解决数字信号处理器(digital signal processor,DSP)的数据供给问题,设计了一个可高效搬运数据的部件———直接存储器访问控制器(direct memory access controller,DMAC)。采用了模拟验证方法和基于断言的验证方法对设计进行了功能验证。传统的模拟验证方法目前仍是主流的功能验证方法,但基于断言的验证方法是今后集成电路验证的发展方向。模拟验证方法虽具有使用简单,不受设计规模影响的优点,却不能证明设计的完备性,而基于断言的验证方法虽具有验证完备性,但能够验证的设计规模有限。把两者结合起来,就能够发挥各自的优点。实验结果表明,把两者结合起来进行验证,确实能够提高验证质量。 展开更多
关键词 数字信号处理器 直接存储器访问控制器 功能验证 模拟验证 基于断言的验证
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基于NiosII的液晶屏控制器SOPC设计 被引量：5
3
作者 宋跃 卢俊平 +2 位作者 雷瑞庭 陈卫 程博 《液晶与显示》 CAS CSCD 北大核心 2014年第1期48-54,共7页
为实现TFT-LCD显示控制器的SOPC-IP设计,选择FPGA-EP4CE6F17C8作为设计验证平台,采用verilog语言,针对全彩AT070TN84TFT-LCD,由Nios II软核处理器、SDRAM控制器、JTAG UART、LCD控制器、Avalon总线等组成TFT-LCD控制器。以Nios II软核... 为实现TFT-LCD显示控制器的SOPC-IP设计,选择FPGA-EP4CE6F17C8作为设计验证平台,采用verilog语言,针对全彩AT070TN84TFT-LCD,由Nios II软核处理器、SDRAM控制器、JTAG UART、LCD控制器、Avalon总线等组成TFT-LCD控制器。以Nios II软核处理器为核心,各IP核(如SDRAM控制器、TFT-LCD控制器等)通过Avalon总线相连接到Nios II上,并通过Avalon总线接口模块、DMA模块、FIFO模块和时序产生模块完成了TFT-LCD控制器IP核设计,实现800×480分辨率,16bit颜色深度的彩色图形显示控制。显示实验运行稳定,图像清晰,色彩丰富,无闪屏、错行等现象,视觉效果良好,设计具有良好的可配置性、复用性和移植性。实践证明该设计行之有效。文中给出了控制器的设计原理、实现方法、仿真与实验过程的同时,重点讲述与控制器IP核相关的各设计环节。 展开更多
关键词 NIOSII SOPC-IP 液晶屏控制器 直接存储器存取
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MCS-DMA:一种面向SoC内DMA传输的内存控制器优化设计 被引量：6
4
作者 黄侃 佟冬 +2 位作者 刘洋 杨寿贵 程旭 《电子学报》 EI CAS CSCD 北大核心 2010年第3期598-604,共7页
当前主流片上总线协议——AHB存在访存带宽利用率较低的问题.本文基于SoC内DMA传输较多的特点,提出一种新的优化设计:在内存控制器内部增加MCS-DMA模块,并通过驱动程序将MCS-DMA模块与目标DMA传输绑定.一方面实现数据预取,提升了单个DM... 当前主流片上总线协议——AHB存在访存带宽利用率较低的问题.本文基于SoC内DMA传输较多的特点,提出一种新的优化设计:在内存控制器内部增加MCS-DMA模块,并通过驱动程序将MCS-DMA模块与目标DMA传输绑定.一方面实现数据预取,提升了单个DMA传输时的总线带宽利用率;另一方面使访存请求在内存控制器内部流水化完成,提升多个DMA并发时的总线带宽利用率.将该设计应用到北大众志SKSoC后,单个DMA传输时的总线带宽利用率提升至100%,多个DMA并发时的总线带宽利用率从33.3%提升至85.5%,而芯片的设计面积仅增加2.9%. 展开更多
关键词 系统芯片 内存控制器 直接内存访问
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一种低开销的面向节点内互连的网络接口控制器 被引量：3
5
作者 苏勇 曹政 +4 位作者 刘飞龙 王展 刘小丽 安学军 孙凝晖 《计算机学报》 EI CSCD 北大核心 2015年第5期909-922,共14页
高性能计算和云计算的飞速发展对高性能互连网络的设计提出了越来越高的要求:除了要保证高带宽、低延迟和高可靠性等特性,还要面临成本和系统规模的挑战.该文针对这些特性和挑战提出了一种低开销的基于cHPP体系结构的超节点网络接口控制... 高性能计算和云计算的飞速发展对高性能互连网络的设计提出了越来越高的要求:除了要保证高带宽、低延迟和高可靠性等特性,还要面临成本和系统规模的挑战.该文针对这些特性和挑战提出了一种低开销的基于cHPP体系结构的超节点网络接口控制器:(1)设计了兼容PCIe的网络通信协议,降低协议转换开销、减少通信延迟并增强系统可扩展性能;(2)采用PCIe高速通信接口并支持用户级通信提高软硬件交互效率,面向MPI编程模型抽象出高效通信原语(如NAP、PUT和GET)加速大数据传输;(3)硬件支持I/O虚拟化实现超节点内对网络接口控制器的高效共享.为了对该文的设计进行功能和性能验证,文章基于FPGA实现了系统原型,实验结果显示最低延迟为1.242μs,有效数据带宽可达3.19GB/s. 展开更多
关键词 互连 网络接口控制器 直接存储器访问 PCI EXPRESS I/O虚拟化
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一种面向高性能计算机的超节点控制器的研究 被引量：4
6
作者 王凯 陈飞 +3 位作者 李强 李晓民 安学军 孙凝晖 《计算机研究与发展》 EI CSCD 北大核心 2011年第1期1-8,共8页
传统高性能计算机的节点由一个处理单元和一个节点控制器组成.为了有效地维护高速缓存一致性,处理单元中的处理器个数会非常有限.因此一台具有千万亿次处理能力的高性能计算机将会有上万个节点,这对互连网络的延迟和带宽都提出了非常高... 传统高性能计算机的节点由一个处理单元和一个节点控制器组成.为了有效地维护高速缓存一致性,处理单元中的处理器个数会非常有限.因此一台具有千万亿次处理能力的高性能计算机将会有上万个节点,这对互连网络的延迟和带宽都提出了非常高的要求.超节点控制器能够同时连接多个处理单元构成一个超节点,这能够减小互连网络的规模,从而降低互连网络的设计难度,并保证互连网络的性能.用FPGA实现了超节点控制器的原型系统的测试结果表明,采用超节点设计的高性能计算机拥有非常低的通信延迟,同时其通信带宽也有非常好的扩展性. 展开更多
关键词 高性能计算机 超节点控制器 全局地址空间 直接内存访问 远程读写
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用FPGA实现PCI-E接口和DMA控制器设计 被引量：20
7
作者 王嘉良 赵曙光 《计算机技术与发展》 2011年第6期181-184,共4页
PCI-Express接口是第三代总线通信接口标准,它采用点对点串行连接方式,具有高速率和高带宽等特点,这是传统PCI并行结构所不能比拟的。为了实现FPGA与CPU之间高速相互通信,介绍了一种用单片FPGA实现PCI-Express接口和高速DMA控制器的设... PCI-Express接口是第三代总线通信接口标准,它采用点对点串行连接方式,具有高速率和高带宽等特点,这是传统PCI并行结构所不能比拟的。为了实现FPGA与CPU之间高速相互通信,介绍了一种用单片FPGA实现PCI-Express接口和高速DMA控制器的设计方法,并在Xilinx Virtex-6 FPGA系列平台上实现。运用Xilinx提供的PCI-Express端点硬核,提出并设计了基于PCI-Express总线的DMA数据传输方案。通过仿真及硬件测试表明,该设计方案成本低、高效,可满足如10Gb以太网数据帧抓取等高速数据采集及分析系统的需要。 展开更多
关键词 PCI-Express总线 FPGA 直接存储器访问
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通用接口控制器GPIO_WB IP核设计与实现 被引量：2
8
作者 张建民 沈胜宇 +2 位作者 宋廷强 高树静 李思昆 《微电子学与计算机》 CSCD 北大核心 2004年第6期194-198,共5页
通用IO接口是SoC系统中非常重要的一种外围端口。本文完成了一种基于WISHBONE总线的GPIO_WB控制器IP核的逻辑设计和物理实现,较具体地介绍了GPIO_WBIP核的体系结构以及WISHBONE接口和DMA传输方式的设计方案,并对所设计实现的GPIO_WB性... 通用IO接口是SoC系统中非常重要的一种外围端口。本文完成了一种基于WISHBONE总线的GPIO_WB控制器IP核的逻辑设计和物理实现,较具体地介绍了GPIO_WBIP核的体系结构以及WISHBONE接口和DMA传输方式的设计方案,并对所设计实现的GPIO_WB性能及可重用性做了分析,结论表明,与已有的通用IO接口IP核相比,GPIO_WBIP核具有性能高、实现代价小、硬件简单、可重用性好、易于扩展等优点。 展开更多
关键词 WISHBONE SOC 互连体系结构 IP核 通用IO接口 直接存储器访问
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一种DDR SDRAM控制器设计 被引量：5
9
作者 蔡钟 吴皓 +1 位作者 刘鹏 王维东 《电视技术》 北大核心 2004年第8期34-36,44,共4页
在分析DDRSDRAM基本操作原理的基础上,提出了一个基于FPGA的DDRSDRAM控制器的设计,实现了DDRSDRAM读写时序控制,并给出实现结果。
关键词 双数据率同步动态随机访问存储器 现场可编程门阵列 控制器
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嵌入式SoC中的DMA控制器的设计与优化 被引量：11
10
作者 史昕蕾 杨军 陆生礼 《电子工程师》 2004年第1期5-7,共3页
当前 ,嵌入式微处理器已从单一功能转向集成更多功能的片上系统 (SoC)。新增和改进功能往往意味着大量的数据传输 ,使得I O设备和存储器之间的数据交换成为新的瓶颈 ,直接存储器存取 (DMA)技术可以有效地缓解这一瓶颈并提高数据传输效... 当前 ,嵌入式微处理器已从单一功能转向集成更多功能的片上系统 (SoC)。新增和改进功能往往意味着大量的数据传输 ,使得I O设备和存储器之间的数据交换成为新的瓶颈 ,直接存储器存取 (DMA)技术可以有效地缓解这一瓶颈并提高数据传输效率。文中主要介绍一种嵌入式SoC中的DMA控制器的设计 ,分析了DMA控制器在一个具体应用中的运行性能 ,并在原有基础上进行了优化 ,根据部分外设的数据吞吐量提出了DMA与AC97控制器之间的专用通道思想 ,实现音频数据的实时传输 ,以满足系统需求 ,并给出了实验数据。 展开更多
关键词 嵌入式微处理器 SOC 片上系统 直接存储器存取 DMA控制器
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延长相变存储器寿命的写操作Cache及其调度策略
11
作者 王党辉 徐如意 +3 位作者 刘朝锋 张萌 安建峰 孙靖国 《西北工业大学学报》 EI CAS CSCD 北大核心 2016年第5期900-906,共7页
相变存储器具有可扩展性好、单元尺寸小、静态功耗低等优点,是替代DRAM做主存的候选器件之一,但其可重复写入的次数有限。提出了一种基于DRAM写操作Cache的相变存储器主存结构,包括存储器控制器、读/写操作数据通路和标志域查找等。同... 相变存储器具有可扩展性好、单元尺寸小、静态功耗低等优点,是替代DRAM做主存的候选器件之一,但其可重复写入的次数有限。提出了一种基于DRAM写操作Cache的相变存储器主存结构,包括存储器控制器、读/写操作数据通路和标志域查找等。同时还提出了相应的调度策略,包括整体的读写调度以及基于写操作频率的替换策略等。仿真结果显示,所提出的方法可将相变存储器的寿命平均延长50%以上,同时使平均仿存延迟降低35%以上。 展开更多
关键词 相变存储器 寿命 控制器 可扩展性 DRAM写操作Cache 调度 替换策略 访问延迟
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TMS320C67系列EMIF与异步FIFO存储器的接口设计 被引量：8
12
作者 顾菘 《电子工程师》 2005年第5期53-55,共3页
介绍了TI公司TMS320C67系列DSP的EMIF(外部存储器接口)与异步FIFO(先进先出)存储器的硬件接口设计,着重描述了用EDMA(扩展的直接存储器访问)方式读取FIFO存储器数据的软件设计流程,最后说明了在选择FIFO存储器时应注意的问题。由于EMIF... 介绍了TI公司TMS320C67系列DSP的EMIF(外部存储器接口)与异步FIFO(先进先出)存储器的硬件接口设计,着重描述了用EDMA(扩展的直接存储器访问)方式读取FIFO存储器数据的软件设计流程,最后说明了在选择FIFO存储器时应注意的问题。由于EMIF的强大功能,不仅具有很高的数据吞吐率,而且可以与不同类型的同步、异步器件进行无缝连接,使硬件接口电路简单调试方便。运用EDMA的方式进行数据传输,由EDMA控制器完成DSP存储空间内的数据搬移,这样可以最大限度地节省CPU的资源,提高整个系统的运算速度。 展开更多
关键词 外部存储器接口(EMIF) 扩展的直接存储器访问 TMS320C67 FIFO存储器
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基于DMA传输方式的SDRAM控制器的设计与实现 被引量：3
13
作者 顾峰 《舰船电子对抗》 2009年第2期108-111,共4页
在简单介绍同步动态随机存储器(SDRAM)的基础上,提出了一种基于直接存储器读取(DMA)传输方式的SDRAM控制器,详细介绍了DMA控制器和SDRAM控制器的设计,并说明了其现场可编程门阵列(FPGA)实现后的性能。
关键词 直接存储器读取传输 同步动态随机存储控制器 现场可编程门阵列
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多通道PCI总线DMA控制器的软硬件联合设计
14
作者 乔庐峰 王志功 《电路与系统学报》 CSCD 2004年第2期73-78,共6页
对一种支持128个用户的PCI(Peripheral Component Interconnect)总线直接存储器访问控制器(DMAC:Direct Memory Access Controller)电路所采用的电路结构进行了分析,在任务级上对电路的功能进行了划分,并通过仿真得到了不同任务分别在... 对一种支持128个用户的PCI(Peripheral Component Interconnect)总线直接存储器访问控制器(DMAC:Direct Memory Access Controller)电路所采用的电路结构进行了分析,在任务级上对电路的功能进行了划分,并通过仿真得到了不同任务分别在采用嵌入式软件和硬件逻辑电路实现时的时间开销和硬件资源开销。在此基础上,采用面向软件的软硬件联合设计方法,以13.5万等效门实现了整个设计,并通过现场可编程门阵列(FPGA)在实际应用系统中进行了功能验证。 展开更多
关键词 超大规模集成电路 PCI总线 直接存储器访问 高级数据链路控制规程 现场可编程门阵列
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应用嵌入式微控制器的数字频率合成实现方法 被引量：1
15
作者 陈砚圃 刘含 +1 位作者 郭博 石立春 《探测与控制学报》 CSCD 北大核心 2023年第5期77-81,87,共6页
无需专用集成电路,仅由嵌入式微控制器实现直接数字频率合成(DDS)而生成波形信号具有经济、灵活、可靠等优点。借助嵌入式微控制器内的定时器、直接存储器存取(DMA)与数模转换(DAC)等片上外设,提出基于定时中断和DMA实现DDS生成波形信... 无需专用集成电路,仅由嵌入式微控制器实现直接数字频率合成(DDS)而生成波形信号具有经济、灵活、可靠等优点。借助嵌入式微控制器内的定时器、直接存储器存取(DMA)与数模转换(DAC)等片上外设,提出基于定时中断和DMA实现DDS生成波形信号的方法。基于定时中断实现DDS生成波形信号的方法无需借助片上DMA,对嵌入式微控制器的要求较低。基于DMA实现DDS生成信号的方法,数据从信号预存区到DAC的传送由并行于CPU工作的DMA完成,支持较高的DDS时钟频率。以正弦信号为例,采用中高端嵌入式微控制器对实现DDS生成信号的两种方法进行实验,结果表明,基于定时中断与DMA的两种方法均能生成波形优异、幅度稳定的信号,但DMA法支持更宽的信号频率范围。 展开更多
关键词 直接数字频率合成 直接存储器存取 数模转换 嵌入式微控制器
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以硬件化软件设计提升微控制器的执行效率 被引量：2
16
作者 怯肇乾 《单片机与嵌入式系统应用》 2020年第8期7-11,共5页
随着批量数据传输的需求和微控制器设计亮点的提升,越来越多的片内外设和接口都做了更多的功能完善和性能加强,使实践应用更加方便。综合使用中断和DMA方式进行传输通信,并基于寄存器进行软件操控,硬件化或扁平化软件设计,只需要数行代... 随着批量数据传输的需求和微控制器设计亮点的提升,越来越多的片内外设和接口都做了更多的功能完善和性能加强,使实践应用更加方便。综合使用中断和DMA方式进行传输通信,并基于寄存器进行软件操控,硬件化或扁平化软件设计,只需要数行代码量就可以完成通常复杂的操作,阻塞和等待省掉了,带来的是“一站式数据块传输”的便利,整个微控制器运行得更加流畅,软件代码执行得更加高效。 展开更多
关键词 实时中断 直接存储器访问 扁平化软件设计 一站式数据块传输
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一种适用于TSN端系统的DMA控制器的设计与仿真分析 被引量：1
17
作者 杜婧 乔庐峰 +1 位作者 陈庆华 王雷淘 《通信技术》 2021年第9期2257-2263,共7页
根据时间敏感网络(Time Sensitive Network,TSN)对端系统的设计需求,设计了一种支持多个逻辑队列且缓冲区共享的直接存储访问(Direct Memory Access,DMA)控制器。DMA控制器内部收发方向上各支持8个逻辑队列,多个逻辑队列共享位于内存中... 根据时间敏感网络(Time Sensitive Network,TSN)对端系统的设计需求,设计了一种支持多个逻辑队列且缓冲区共享的直接存储访问(Direct Memory Access,DMA)控制器。DMA控制器内部收发方向上各支持8个逻辑队列,多个逻辑队列共享位于内存中的缓存空间,可对不同类型的数据帧提供差异化的收发调度和处理。DMA控制器采用基于指针的收发逻辑队列结构和复杂的缓冲区描述符,可以有效降低处理器负荷,提高总线吞吐率。整个设计在Xilinx ZYNQ7035的开发板上进行了仿真分析和功能验证。 展开更多
关键词 时间敏感网络 直接存储器访问 AXI总线 描述符
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Atmel ARM7闪存微控制器
18
《电子产品世界》 2006年第12X期32-32,共1页
爱特梅尔公司（Atmel）现已为基于ARM7的USB做控制器SAM7系列增添二款新产品。全新的SAM7SE微控制器（MCU）备有32、256和512Kbyte的闪存容量选择，据称是业界唯一配有外部总线接口（external bus interfacc，EBI）的ARM7 MCU，能够直... 爱特梅尔公司（Atmel）现已为基于ARM7的USB做控制器SAM7系列增添二款新产品。全新的SAM7SE微控制器（MCU）备有32、256和512Kbyte的闪存容量选择，据称是业界唯一配有外部总线接口（external bus interfacc，EBI）的ARM7 MCU，能够直接访问大容量的外部NAND闪存、SDRAM、CompactFlashSRAM以及ROM存储器。 展开更多
关键词 闪存微控制器 ARM7 ATMEL NAND闪存 SDRAM 容量选择 总线接口 直接访问
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爱特梅尔推出具有USB和高精度模拟功能的超低功耗8/16位微控制器
19
《电子与电脑》 2011年第8期72-72,共1页
爱特梅尔公司（Atmel）现已为其获市场公认的8／16位AVRXMEGA微控制器（MCU）系列增添独特功能，即100nA业界最低耗电量和5μS唤醒时间。全新Atmel AVRXMEGA系列包括全速USB、最快的最高精度模拟系统、一个直接存储器存取（DMA）控制器... 爱特梅尔公司（Atmel）现已为其获市场公认的8／16位AVRXMEGA微控制器（MCU）系列增添独特功能，即100nA业界最低耗电量和5μS唤醒时间。全新Atmel AVRXMEGA系列包括全速USB、最快的最高精度模拟系统、一个直接存储器存取（DMA）控制器和创新的事件系统， 展开更多
关键词 16位微控制器 模拟功能 高精度 USB 超低功耗 直接存储器存取 梅 模拟系统
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超长LED显示屏控制系统的实现 被引量：9
20
作者 刘全 靳桅 《液晶与显示》 CAS CSCD 北大核心 2008年第6期744-750,共7页
针对超长LED显示屏数据输出速度慢这一瓶颈因素,从合理组织显示数据和提升硬件性能两方面着手探讨了解决办法。在分析数据组织算法和铁电单片机VRS51L3074硬件优势的基础上给出了相应的控制系统。方案的特点是将显示数据按输出顺序完整... 针对超长LED显示屏数据输出速度慢这一瓶颈因素,从合理组织显示数据和提升硬件性能两方面着手探讨了解决办法。在分析数据组织算法和铁电单片机VRS51L3074硬件优势的基础上给出了相应的控制系统。方案的特点是将显示数据按输出顺序完整连续地排列在存储器中,由控制电路完成显示数据以DMA方式直接输出,并利用VRS51L3074的CS3扩展功能自动产生移位时钟,同时结合软件优化实现显示数据的高速输出。测试表明该系统能够可靠地驱动宽度为2048列的超长LED显示屏并满足高刷新频率的要求,其控制功能具有易于扩展和可灵活配置的特点。 展开更多
关键词 LED显示屏 控制系统 数据组织 VRS51L3074 CS3 直接存储器访问
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