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用于植入式医疗装置的逐次逼近式模数转换器 被引量：9
1
作者 张鸿 张牡丹 +2 位作者 张杰 赵阳 张瑞智 《西安交通大学学报》 EI CAS CSCD 北大核心 2015年第2期43-48,129,共7页
针对植入式医疗装置对模数转换器（ADC）的超低功耗和高精度要求,提出了一种共模恒定型分段混合编码结构的逐次逼近式模数转换器（SAR-ADC）。该SAR-ADC的电容数模转换器DAC中采用分段混合编码结构,兼具了分段二进制编码的低功耗优势和... 针对植入式医疗装置对模数转换器（ADC）的超低功耗和高精度要求,提出了一种共模恒定型分段混合编码结构的逐次逼近式模数转换器（SAR-ADC）。该SAR-ADC的电容数模转换器DAC中采用分段混合编码结构,兼具了分段二进制编码的低功耗优势和分段温度计编码的高线性度优势。共模恒定型控制方式具有极低的动态功耗。采用HHNEC 0.35μm CMOS工艺完成了10位共模恒定型分段混合编码SAR-ADC的电路和版图设计。后仿真结果表明：所设计的SARADC的电源电压范围为1.8~3V;在采样率为103 s-1的条件下,其有效位数为9.4位;整个SARADC所消耗的电流仅为60nA,在同等工艺条件下具有更低的功耗;所设计的转换器能够满足心脏起搏器等植入式医疗装置的需求。 展开更多
关键词 医疗装置 植入式 超低功耗 逐次逼近型 模数转换器
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低功耗高精度逐次逼近型模数转换器的设计 被引量：5
2
作者 袁小龙 赵梦恋 +1 位作者 吴晓波 严晓浪 《浙江大学学报（工学版）》 EI CAS CSCD 北大核心 2006年第12期2153-2157,共5页
为解决现代数字和数模混合系统中动态模数转换器高精度、低功耗与低成本之间的矛盾,提出一种10位和200×103/s采样数的逐次逼近式模数转换器(SAR-ADC).对电容式数模转换器电容阵列的导通时序进行了优化,在采样保持电路中加入消失调... 为解决现代数字和数模混合系统中动态模数转换器高精度、低功耗与低成本之间的矛盾,提出一种10位和200×103/s采样数的逐次逼近式模数转换器(SAR-ADC).对电容式数模转换器电容阵列的导通时序进行了优化,在采样保持电路中加入消失调功能,在比较器设计中引入预增益级和锁存级.该模数转换器已在标准数字互补性金属氧化物半导体工艺下实现.测试结果表明,该转换器积分非线性度小于1个最低有效位(LSB),差分非线性度小于0.5 LSB.在200 kHz采样率和191 Hz输入信号频率下信噪比为59 dB,并且在5 V供电电压下功耗为2.5mW,芯片面积为1.3 mm2,其性能已达到ADC高线性度和低功耗的设计要求. 展开更多
关键词 逐次逼近式模数转换器 比较器 开关时序 积分非线性 低功耗
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一种嵌入式10位2MS/s逐次逼近模数转换器 被引量：2
3
作者 周云波 陈珍海 于宗光 《中国电子科学研究院学报》 2011年第1期7-11,共5页
设计了一种10位2 MS/s嵌入式逐次逼近结构ADC。为提高ADC精度,其中DAC采用电压和电荷按比例缩放混合结构,比较器使用了输入失调校准和输出失调校准技术。采用TSMC0.18μm1P6M数字CMOS工艺进行流片验证,整个ADC核面积仅为0.9×0.6 mm... 设计了一种10位2 MS/s嵌入式逐次逼近结构ADC。为提高ADC精度,其中DAC采用电压和电荷按比例缩放混合结构,比较器使用了输入失调校准和输出失调校准技术。采用TSMC0.18μm1P6M数字CMOS工艺进行流片验证,整个ADC核面积仅为0.9×0.6 mm2。测试结果表明,在2 MHz采样率、输入信号为180 kHz正弦信号情况下,该ADC模块具有8.51位的有效分辨率,最大微分非线性为-0.8^+0.7LSB,最大积分非线性为-1.7^+1.5 LSB,而整个模块的功耗仅为1.2 mW。 展开更多
关键词 逐次逼近 嵌入式模数转换器 数模转换器 比较器
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一种逐次逼近寄存器型模数转换器 被引量：4
4
作者 石蓝 居水荣 +1 位作者 丁瑞雪 朱樟明 《半导体技术》 CAS 北大核心 2020年第12期916-923,共8页
设计了一种逐次逼近寄存器型模数转换器(SAR ADC)。提出了一种新型全动态钟控比较器结构,消除了比较器的亚稳态误差,解决了ADC输出不稳定的问题,实现了失调和噪声之间良好的折中,提升了ADC的动态性能;设计了一种全新的自举开关,在确保... 设计了一种逐次逼近寄存器型模数转换器(SAR ADC)。提出了一种新型全动态钟控比较器结构,消除了比较器的亚稳态误差,解决了ADC输出不稳定的问题,实现了失调和噪声之间良好的折中,提升了ADC的动态性能;设计了一种全新的自举开关,在确保采样保持电路性能的同时提高了其可靠性;提出了一种新颖的正反馈结构的动态逻辑单元,并应用在逐次逼近逻辑电路中,在降低功耗的同时消除了误码问题;改进了共模电平产生电路结构,提高了共模电平的产生速度和稳定性。电路采用0.18μm DB S-BCD工艺设计实现,芯片面积约为360μm×560μm,10 bit分辨率模式下的功耗和信噪失真比(SNRD)分别为21.1μW和58.64 dB。 展开更多
关键词 模数转换器(ADC) 逐次逼近寄存器(SAR) 比较器 自举开关 动态逻辑单元 共模电平
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一种采用时域比较器的低功耗逐次逼近型模数转换器的设计 被引量：3
5
作者 张蕾 杨晨晨 王兴华 《北京理工大学学报》 EI CAS CSCD 北大核心 2020年第5期526-530,共5页
基于CMOS 90 nm工艺设计了一款采用时域比较器的10位逐次逼近型模数转换器(successive approximation register analog-to-digital convertor,SAR ADC).与传统动态比较器相比,时域比较器利用差分多级电压控制型延时线将电压信号转为时... 基于CMOS 90 nm工艺设计了一款采用时域比较器的10位逐次逼近型模数转换器(successive approximation register analog-to-digital convertor,SAR ADC).与传统动态比较器相比,时域比较器利用差分多级电压控制型延时线将电压信号转为时间信号,并通过鉴相器鉴别相位差而得到比较器结果,减小了共模偏移对比较器的影响和静态功耗.同时,电路采用部分单调式的电容阵列电压转换过程,有效减小电容阵列总电容及其功耗.仿真结果表明,在电源电压1 V,采样率308 kS/s,信号幅度0.9 V的情况下,有效位数(ENOB)为9.45 bits,功耗为13.48μW. 展开更多
关键词 逐次逼近模数转换器 模数转换器时域比较器 低功耗
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用于植入式医疗设备的低功耗低位逐次逼近型模数转换器 被引量：4
6
作者 许江涛 闫创 +3 位作者 段颖哲 翟羽健 伍民顺 张瑞智 《西安交通大学学报》 EI CAS CSCD 北大核心 2020年第3期12-19,共8页
针对植入式医疗设备中关键模块模数转换器(ADC)的超低功耗设计问题,以低功耗的逐次逼近型ADC为基础,提出了低位逐次逼近量化逻辑的模数转换器。量化逻辑主要用于以心电信号为代表的低活动度生物信号,在采用固定分辨率和采样率的情况下,... 针对植入式医疗设备中关键模块模数转换器(ADC)的超低功耗设计问题,以低功耗的逐次逼近型ADC为基础,提出了低位逐次逼近量化逻辑的模数转换器。量化逻辑主要用于以心电信号为代表的低活动度生物信号,在采用固定分辨率和采样率的情况下,根据信号的变化幅度调整量化次数,以达到降低功耗和压缩数据量的目的,在信号处于基线或缓变间期最少只需要3次量化就可以得到ADC转换结果。采用Global Foundry 0.18m标准CMOS工艺对该ADC进行了电路和版图设计,仿真结果显示,在1.8V的电源电压和1kHz的采样率下,ADC的有效位为9.6b,核心电路平均电流功耗为64~131nA。该低位逐次逼近模数转换器特别适合应用于植入或可穿戴医疗设备中低活动度生物信号的模数转换,在保证量化精度的同时显著降低了ADC的功耗。 展开更多
关键词 植入式医疗设备 低功耗 低位逐次逼近 模数转换器
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基于建立-向下偏转过程11-bit 1-MS/s逐次逼近型模数转换器的设计 被引量：1
7
作者 常玉春 余昭杰 +3 位作者 李靖 曹令今 李强 杜国同 《吉林大学学报（工学版）》 EI CAS CSCD 北大核心 2013年第2期480-484,共5页
采用0.35μm CMOS工艺设计了一款基于建立-向下(set-and-down)偏转过程11-bit1-MS/s的逐次逼近型模数转换器(SAR ADC),分析了电容网络的偏转过程。采用本文电容偏转过程的11-bit SAR ADC平均电容偏转能耗比传统的SAR ADC降低了81.25%,... 采用0.35μm CMOS工艺设计了一款基于建立-向下(set-and-down)偏转过程11-bit1-MS/s的逐次逼近型模数转换器(SAR ADC),分析了电容网络的偏转过程。采用本文电容偏转过程的11-bit SAR ADC平均电容偏转能耗比传统的SAR ADC降低了81.25%,且单位电容的总数与传统SAR ADC相比也降低了50%。采用0.35μm 2P3M CMOS工艺对SARADC电路进行了版图绘制,版图尺寸约为705μm×412μm。后仿真结果表明,信号与噪声和失真比达到了66.6dB,有效精度达到了10.7bit。 展开更多
关键词 光电子学与激光技术 模数转换器 逐次逼近 平均电容偏转能耗 有效精度
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多通道逐次逼近型10bit 40Ms/s模数转换器的设计 被引量：1
8
作者 殷勤 戚韬 +1 位作者 吴光林 吴建辉 《电子器件》 EI CAS 2006年第4期1126-1130,共5页
设计了一个多通道逐次逼近型结构的10 bit 40 Ms/s模数转换器(ADC)。由于采用时间交叉存取技术,提高了整个芯片的转换速度,同时通过运用比较器自校准和电容自校准结构,提高了整个电路的转换精度。本芯片采用Chart 0.25μm2.5 V工艺,版... 设计了一个多通道逐次逼近型结构的10 bit 40 Ms/s模数转换器(ADC)。由于采用时间交叉存取技术,提高了整个芯片的转换速度,同时通过运用比较器自校准和电容自校准结构,提高了整个电路的转换精度。本芯片采用Chart 0.25μm2.5 V工艺,版图面积为1.4 mm×1.3 mm。40 MHz工作时,平均功耗为33.68 mW。输入频率19.9 MHz时,信号噪声失真比(SINAD)为59.653 3 dB,无杂散动态范围(SFDR)为74.864 6 dB。 展开更多
关键词 模数转换器 逐次逼近 时间交叉存取 自校准比较器 电容校准
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汽车电子MCU中的16通道10 bit 1 MHz逐次逼近模数转换器设计
9
作者 陈铖颖 黑勇 +1 位作者 戴澜 胡晓宇 《固体电子学研究与进展》 CAS CSCD 北大核心 2013年第1期80-85,共6页
逐次逼近模数转换器(SAR ADC)具有中等转换精度和速度,在精度、速度、功耗以及成本方面具有综合优势,且易于实现多路控制,广泛应用于工业控制、医疗仪器以及微控制器(MCU)等领域中。采用GSMC0.18μm1P6M CMOS混合信号工艺,设计了一款用... 逐次逼近模数转换器(SAR ADC)具有中等转换精度和速度,在精度、速度、功耗以及成本方面具有综合优势,且易于实现多路控制,广泛应用于工业控制、医疗仪器以及微控制器(MCU)等领域中。采用GSMC0.18μm1P6M CMOS混合信号工艺,设计了一款用于汽车电子MCU的16通道10bit1MHz逐次逼近模数转换器。测试结果表明,在电源电压1.8V,输入信号51kHz和1MHz时钟频率下,无杂散动态范围(SFDR)71.364dB,有效位数(ENOB)达到9.49bit,整体功耗2.24mW,满足汽车电子MCU的应用需求。 展开更多
关键词 逐次逼近 模数转换器 微控制器 数模转换器
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一种新型跟踪式逐次逼近模数转换器
10
作者 于宝亮 冯海刚 《微电子学与计算机》 CSCD 北大核心 2018年第1期124-127,132,共5页
为了降低功耗和复杂度,采用复用量化器结构,而不需要传统结构中的减法和数模转换器模块(DAC),实现一低功耗简单的跟踪式模数转换器.量化器采用8bit电容单调式切换的逐次逼近模数转换器(SAR ADC).另外为了进一步提高效率,SAR ADC中的比... 为了降低功耗和复杂度,采用复用量化器结构,而不需要传统结构中的减法和数模转换器模块(DAC),实现一低功耗简单的跟踪式模数转换器.量化器采用8bit电容单调式切换的逐次逼近模数转换器(SAR ADC).另外为了进一步提高效率,SAR ADC中的比较器采用时间域比较器实现.经过在90nm CMOS工艺下仿真验证,设计的ADC采样速度16 MHz,8倍过采样率(OSR).经过数字滤波处理,输入信号频率为227kHz时,可以实现59.6dB的信噪失真比(SNDR),功耗28.5μW,品质因数(FOM)18.4fJ/step.另外,由于转换过程主要在数字域实现,这种ADC便于移植到更先进的工艺,并获得更好的效率. 展开更多
关键词 跟踪式模数转换器 逐次逼近模数转换器 时间域比较器 低功耗 高效率
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逐次逼近型模数转换器研究进展 被引量：3
11
作者 田芮谦 宋树祥 +3 位作者 刘振宇 岑明灿 蒋品群 蔡超波 《广西师范大学学报（自然科学版）》 CAS 北大核心 2022年第5期24-35,共12页
逐次逼近型模数转换器(successive approximation register analog-to-digital converter,SAR ADC)已占据中等速度和精度ADC的主要市场,其采样频率可达5 MHz,分辨率通常为8~16位。在保持其低功耗的固有优势下,SAR ADC设计面临更高速和... 逐次逼近型模数转换器(successive approximation register analog-to-digital converter,SAR ADC)已占据中等速度和精度ADC的主要市场,其采样频率可达5 MHz,分辨率通常为8~16位。在保持其低功耗的固有优势下,SAR ADC设计面临更高速和更高精度的挑战。本文概述近年来逐次逼近型模数转换器的研究现状和先进技术,对电容阵列开关切换技术、比较器和校准方法进行归纳与讨论;对比了结合不同开关策略的电容阵列DAC性能;提出了适用于不同场景的比较器结构;对高速度、高精度、低功耗的SAR ADC研究进行了展望。 展开更多
关键词 逐次逼近 模数转换器 开关切换技术 比较器 校准
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面向WSN结点SoC的逐次逼近模数转换器 被引量：1
12
作者 刘珂 杜占坤 +3 位作者 马骁 邵莉 毕见鹏 傅健 《半导体技术》 CAS CSCD 北大核心 2013年第1期1-5,15,共6页
设计了一种适合于无线传感网(WSN)结点SoC芯片传感器接口电路应用的12 bit精度逐次逼近型(SAR)模数转换器(ADC)。为了实现高精度、低成本,并兼容射频CMOS工艺的要求,利用全差分结构和带有Auto-zero失调消除功能的比较器提高转换精度。... 设计了一种适合于无线传感网(WSN)结点SoC芯片传感器接口电路应用的12 bit精度逐次逼近型(SAR)模数转换器(ADC)。为了实现高精度、低成本,并兼容射频CMOS工艺的要求,利用全差分结构和带有Auto-zero失调消除功能的比较器提高转换精度。采用分段式电容阵列DAC减小芯片占用面积,通过构造符合精度要求的MOM电容单元,使电容阵列符合射频CMOS的工艺特点,利于嵌入式应用。同时,采取增加辅助电容的办法扩大输入信号范围。该ADC在0.18μm 1P6M标准CMOS工艺下实现,版图面积为0.9 mm2,最高采样速率为1 MS/s,在1.8 V电源电压下,整体功耗仅为2 mW。 展开更多
关键词 逐次逼近型 模数转换器 无线传感网 片上系统 低功耗
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逐次逼近(SAR)模数转换器进展 被引量：2
13
作者 刘萌 马奎 +1 位作者 刘娇 傅兴华 《电子设计工程》 2015年第15期8-12,共5页
介绍了逐次逼近模数转换器(SAR-ADC)的原理结构和研究现状,主要对SAR-ADC中的DAC、比较器、校准方法等主要模块进行了讨论。基于精度、速度、功耗的考虑,分别对SAR-ADC中的DAC结构进行分析比较,其多采用分段电容阵列或差分电容阵列。简... 介绍了逐次逼近模数转换器(SAR-ADC)的原理结构和研究现状,主要对SAR-ADC中的DAC、比较器、校准方法等主要模块进行了讨论。基于精度、速度、功耗的考虑,分别对SAR-ADC中的DAC结构进行分析比较,其多采用分段电容阵列或差分电容阵列。简述了比较器在功耗、速度、精度方面的结构调整。基于降低非理想效应,提高精度目的,对比分析了3种校准方法。为不同电路选择适当校准提供参考依据。最后总结了目前SAR-ADC的发展趋势。 展开更多
关键词 逐次逼近 模数转换器 DAC 比较器 校准
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低功耗逐次逼近寄存器模数转换器综述 被引量：4
14
作者 丁召明 周雄 李强 《微电子学》 CAS CSCD 北大核心 2018年第3期401-405,415,共6页
总结了低功耗逐次逼近寄存器模数转换器代表性技术及解决方案的最新研究进展。这些模数转换器采用的结构包括有采样开关信号泵升结构、电容阵列翻转结构、低功耗比较器结构等。从逐次逼近寄存器模数转换器各模块设计的角度,介绍了各种... 总结了低功耗逐次逼近寄存器模数转换器代表性技术及解决方案的最新研究进展。这些模数转换器采用的结构包括有采样开关信号泵升结构、电容阵列翻转结构、低功耗比较器结构等。从逐次逼近寄存器模数转换器各模块设计的角度,介绍了各种改进的新技术。介绍了预量化技术和旁路窗技术。这两种技术通过优化电路结构和增加辅助电路,实现模数转换器的低功耗。该综述为设计者了解新的低功耗逐次逼近型模数转换器研究提供了有益参考。 展开更多
关键词 低功耗 逐次逼近寄存器 模数转换器
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一种用于逐次逼近模数转换器的时域比较器 被引量：1
15
作者 岑远军 伍钰涵 樊华 《实验科学与技术》 2018年第1期32-36,共5页
高精度、高线性度、低功耗的模数转换器是传感器的重要组成部分。相比其他类型的模数转换器,逐次逼近模数转换器(SAR ADC)具有结构简单、面积小、功耗低、易实现可编程、数字化程度高等优点,已经广泛地应用于无线传感网络。该文提出了... 高精度、高线性度、低功耗的模数转换器是传感器的重要组成部分。相比其他类型的模数转换器,逐次逼近模数转换器(SAR ADC)具有结构简单、面积小、功耗低、易实现可编程、数字化程度高等优点,已经广泛地应用于无线传感网络。该文提出了一种新颖的高速、数字化的时域比较器,能用于单端和差分逐次逼近模数转换器,相比传统的时间域比较器,该文提出的时间域比较器具有精度高和速度快的特点。 展开更多
关键词 模数转换器 逐次逼近 时间域 比较器
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一种高速低功耗10位逐次逼近模数转换器设计
16
作者 梅逢城 贺林 +1 位作者 吕伟 林福江 《微电子学》 CAS CSCD 北大核心 2015年第2期160-163,共4页
通过分析并优化逐次逼近模数转换器(SAR ADC)的工作时序,设计并实现了一种高速、低功耗、具有误差补偿的10位100 MS/s A/D转换器。该芯片采用TSMC 0.13μm CMOS工艺进行设计。后仿真结果表明,在1.2V电源电压、20.3125MHz输入信号频率、1... 通过分析并优化逐次逼近模数转换器(SAR ADC)的工作时序,设计并实现了一种高速、低功耗、具有误差补偿的10位100 MS/s A/D转换器。该芯片采用TSMC 0.13μm CMOS工艺进行设计。后仿真结果表明,在1.2V电源电压、20.3125MHz输入信号频率、100MHz采样频率下,模数转换器的无杂散动态范围(SFDR)为68.1dB,有效位数(ENOB)达到9.41位,整体功耗为0.865mW,FoM值为15fJ/conv。芯片核心电路面积为(0.02×0.02)mm2。 展开更多
关键词 误差补偿 逐次逼近模数转换器 高速 低功耗 CMOS
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电荷再分配逐次逼近模数转换器开关时序综述 被引量：1
17
作者 辛昕 毛文 佟星元 《西安邮电大学学报》 2022年第3期46-52,共7页
电容阵列是限制电荷再分配逐次逼近(Successive Approximation Register,SAR)模数转换器能耗和面积的主要模块。从当前SAR模数转换器电容阵列在开关时序能耗和面积方面的相关研究工作,可得电容陈列开关时序设计忽略了比较器设计难度和... 电容阵列是限制电荷再分配逐次逼近(Successive Approximation Register,SAR)模数转换器能耗和面积的主要模块。从当前SAR模数转换器电容阵列在开关时序能耗和面积方面的相关研究工作,可得电容陈列开关时序设计忽略了比较器设计难度和参考电平数量的影响,导致SAR模数转换器的能效并未显著提升。对电荷再分配SAR模数转换器传统开关时序、单调开关时序、基于共模电平的(V_(cm)-based)开关时序以及近年来的多种开关时序进行理论分析与仿真软件建模验证,发现积分非线性分裂(Integral Non-linearity Splitting,INLS)开关时序在能耗、面积和线性度上实现了协同优化。通过分析总结了现有主要开关时序的优缺点,并展望了电荷再分配SAR模数转换器开关时序的发展趋势和方向。 展开更多
关键词 逐次逼近 模数转换器 电容阵列 开关时序
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可穿戴脑电监测系统的低功耗逐次逼近型模数转换器设计 被引量：1
18
作者 潘梓忱 姚剑敏 严群 《仪表技术》 2023年第6期5-8,42,共5页
基于TSMC 180 nm芯片工艺,设计了一个用于可穿戴脑电监测的10位低功耗逐次逼近型模数转换器(SAR ADC)。为了有效降低DAC电容阵列的切换功耗,采用新型差分DAC电容阵列,并使用单调开关切换方式。比较器采用两级动态比较器,在提高效率的同... 基于TSMC 180 nm芯片工艺,设计了一个用于可穿戴脑电监测的10位低功耗逐次逼近型模数转换器(SAR ADC)。为了有效降低DAC电容阵列的切换功耗,采用新型差分DAC电容阵列,并使用单调开关切换方式。比较器采用两级动态比较器,在提高效率的同时也降低功耗及噪声。针对脑电信号的特点,采用栅压自举开关实现高线性的采样。后仿真结果表明:在1.8 V供电电压、40 kS/s采样率下,这款SAR ADC的功耗仅为2.4μW,其有效位数(ENOB)为9.68 bit,无杂散动态范围(SFDR)为70.6 dB,优值为73.1 fJ/(conv-step),设计的SAR ADC适用于可穿戴脑电监测设备。 展开更多
关键词 脑电信号 低功耗 逐次逼近寄存器 模数转换器 单调开关切换
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超低功耗10bit逐次逼近模数转换器
19
作者 金星 朱从义 +1 位作者 马文龙 张耀辉 《微计算机信息》 2010年第35期177-179,共3页
本文研究设计了一种基于CMOS 0.18um工艺下的30uw超低功耗10bit逐次逼近模数转换器(SAR ADC)。本结构为在1.2V低电源电压条件下使用全差分结构,使用1V作为参考电平,经前仿SNR有55.8dB。两个完全对称的电容阵列接入带自校准的比较器,比... 本文研究设计了一种基于CMOS 0.18um工艺下的30uw超低功耗10bit逐次逼近模数转换器(SAR ADC)。本结构为在1.2V低电源电压条件下使用全差分结构,使用1V作为参考电平,经前仿SNR有55.8dB。两个完全对称的电容阵列接入带自校准的比较器,比较器再接入存储器中。为了提高逐次逼近模数转换器的精度、匹配度以及减小整个电容面积,电容阵列采用了与以往传统结构不同的分级电容的方式,所有单元电容都使用相同大小样式的电容。芯片采用Chartered 0.18um工艺实现,并对芯片进行了测试。 展开更多
关键词 逐次逼近模数转换器 超低功耗 全差分 自校准 电容阵列
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六位逐次逼近型模数转换器的设计
20
作者 邹佳 李开航 王日炎 《电子世界》 2016年第6期46-48,共3页
为满足北斗多模导航SOC对中等精度、低功耗ADC的需求,本文基于Smic40工艺对六位全差分SARADC的主要功能模块进行了设计,比较器部分采用Latch结构降低功耗,通过增加前置运放减小失调电压。采用电荷重分布DAC降低了电容匹配性要求,减小了... 为满足北斗多模导航SOC对中等精度、低功耗ADC的需求,本文基于Smic40工艺对六位全差分SARADC的主要功能模块进行了设计,比较器部分采用Latch结构降低功耗,通过增加前置运放减小失调电压。采用电荷重分布DAC降低了电容匹配性要求,减小了非线性误差。驱动Buffer采用折叠式共源共栅栅压浮动AB类运放,降低了整体的功耗。通过手动搭建整个逻辑控制电路,更加深刻的理解了整个系统的逻辑控制要求。 展开更多
关键词 逐次逼近模数转换器 比较器 D/A转换器
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